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LNK626 輸出電壓隨負(fù)載電流升高而降低，何解？

為方便大家閱貼，最新的測(cè)試數(shù)據(jù)見新貼：

http://www.e-ticket.cn/bbs/1516173.html

dialup參數(shù)做了調(diào)整，重新測(cè)試了最新的波形。仍有問(wèn)題，請(qǐng)大家?guī)兔纯?

電路圖及波形圖如下。 

原理圖中反饋電阻實(shí)際貼的值為【9.1K，20K】，【2.4K，5.1K】不同比例的結(jié)果基本一樣。電路中的電阻值不能使用。

10V輸出為主輸出。

原邊感量計(jì)算值為1311uH，漏感38uH，實(shí)際測(cè)試結(jié)果滿足誤差要求。

問(wèn)題： 負(fù)載電流從0逐漸加大到800mA，輸出電壓逐漸下降到8.5V（純電阻負(fù)載）。嘗試跟換反饋電阻值，沒(méi)有明顯改善。

請(qǐng)大家?guī)兔Ψ治鰡?wèn)題出在什么地方。謝謝！

未命名

1，VDS導(dǎo)通部分細(xì)節(jié)

77777

2 ，原邊電流

新建文件0

3，VDS波形，穩(wěn)定電壓368V

新建文件1

4，反饋繞組電壓波形，負(fù)載小時(shí)穩(wěn)定電壓6.8V，負(fù)載電流增加接近700mA時(shí)，電壓值明顯下降

新建文件2

5，F(xiàn)B管腳電壓，1.44V

新建文件3

全部回復(fù)(28)
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power_hh
LV.5
2
2015-08-14 20:34
變壓器繞制有問(wèn)題，帶載有點(diǎn)問(wèn)題，
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謝厚林
LV.12
3
2015-08-17 09:45

你是多路輸出嗎？多路輸出的漏感大，造成Vds波形振蕩時(shí)間比較久。箝位電容改小點(diǎn)，改為470pF

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謝厚林
LV.12
4
2015-08-17 09:46
@謝厚林
你是多路輸出嗎？多路輸出的漏感大，造成Vds波形振蕩時(shí)間比較久。箝位電容改小點(diǎn)，改為470pF
另外多路輸出會(huì)造成偵測(cè)不準(zhǔn)的問(wèn)題。
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tanb006
LV.10
5
2015-08-26 20:08

沒(méi)辦法跟蹤的那么完美。

建議次級(jí)另加個(gè)線性穩(wěn)壓。

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feiban001
LV.3
6
2015-08-31 09:06
@謝厚林
你是多路輸出嗎？多路輸出的漏感大，造成Vds波形振蕩時(shí)間比較久。箝位電容改小點(diǎn)，改為470pF

謝謝，前幾天老婆生孩子，一直沒(méi)上班。 我馬上試試你說(shuō)的方案。

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feiban001
LV.3
7
2015-08-31 16:23
@謝厚林
你是多路輸出嗎？多路輸出的漏感大，造成Vds波形振蕩時(shí)間比較久。箝位電容改小點(diǎn)，改為470pF

根據(jù)你說(shuō)的辦法，將電容改?。▋蓚€(gè)1n電容串聯(lián)），沒(méi)有明顯改善。 電容加大（2個(gè)1n并聯(lián)），倒是有改善 --- 空載12.6V（有12K假負(fù)載），適當(dāng)帶載后輸出在10.2~10.4之間波動(dòng)。比之前好一些。 不過(guò)，可聞噪音也變得明顯。30%~100%負(fù)載范圍內(nèi)都有噪音。

另，4.5V輸出在5.2~6.3V之間波動(dòng)。（目前不考慮這組輸出了）

如果將4.5V輸出繞組去掉，只保留一組輸出，是否可以改善以上問(wèn)題？ 

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謝厚林
LV.12
8
2015-09-01 09:14
@feiban001
根據(jù)你說(shuō)的辦法，將電容改小（兩個(gè)1n電容串聯(lián)），沒(méi)有明顯改善。電容加大（2個(gè)1n并聯(lián)），倒是有改善---空載12.6V（有12K假負(fù)載），適當(dāng)帶載后輸出在10.2~10.4之間波動(dòng)。比之前好一些。不過(guò)，可聞噪音也變得明顯。30%~100%負(fù)載范圍內(nèi)都有噪音。另，4.5V輸出在5.2~6.3V之間波動(dòng)。（目前不考慮這組輸出了）如果將4.5V輸出繞組去掉，只保留一組輸出，是否可以改善以上問(wèn)題？ 

噪音解決辦法，變壓器的磁芯中心柱點(diǎn)膠。

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feiban001
LV.3
9
2015-09-01 09:59
@謝厚林
噪音解決辦法，變壓器的磁芯中心柱點(diǎn)膠。
變壓器是浸過(guò)漆的
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謝厚林
LV.12
10
2015-09-01 13:35
@feiban001
變壓器是浸過(guò)漆的

沒(méi)點(diǎn)膠吧？

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feiban001
LV.3
11
2015-09-01 15:02
@謝厚林
沒(méi)點(diǎn)膠吧？

可能吧，變壓器廠做的樣品。 噪音這個(gè)問(wèn)題先放放。 

RCD的參數(shù)該如何確定最佳值？ 目前用的2nF，電阻不變。不知道會(huì)不會(huì)有問(wèn)題。

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謝厚林
LV.12
12
2015-09-06 09:42
@feiban001
可能吧，變壓器廠做的樣品。噪音這個(gè)問(wèn)題先放放。 RCD的參數(shù)該如何確定最佳值？目前用的2nF，電阻不變。不知道會(huì)不會(huì)有問(wèn)題。

輕載，空載時(shí)有噪音，要把箝位電容改為薄膜電容。

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2015-09-06 17:59
你是多路輸出嗎？多路輸出的漏感大，造成Vds波形振蕩時(shí)間比較久。箝位電容改小點(diǎn)，改為470pF
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2015-09-07 08:48
**此帖已被管理員刪除**
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謝厚林
LV.12
15
2015-09-07 09:09
@q若不棄永相惜q
**此帖已被管理員刪除**

箝位電容要改小，因?yàn)?25的偵測(cè)方式的問(wèn)題，在MOS關(guān)斷后的2.5US的地方偵測(cè)，所以在漏感大的設(shè)計(jì)中，最好把電容改小，振蕩的時(shí)間就會(huì)短，保證在2.5uS的地方?jīng)]有振蕩。

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dakjncdc
LV.7
16
2015-09-07 10:27
變壓器繞制有問(wèn)題，帶載有點(diǎn)問(wèn)題，
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feiban001
LV.3
17
2015-09-08 09:11
@謝厚林
箝位電容要改小，因?yàn)?25的偵測(cè)方式的問(wèn)題，在MOS關(guān)斷后的2.5US的地方偵測(cè)，所以在漏感大的設(shè)計(jì)中，最好把電容改小，振蕩的時(shí)間就會(huì)短，保證在2.5uS的地方?jīng)]有振蕩。

我再試試。 

2.5us的位置，振鈴剛好結(jié)束。 測(cè)了1/2/3nF的電容，RCD中D串聯(lián)的電阻也從0變到100，都試過(guò)，基本上都是在振鈴結(jié)束的地方剛好2.5uS

之前將電容改小，似乎也沒(méi)有看到對(duì)振鈴有明顯改善的意思啊。  另外，直觀理解，電容大了不是有利于壓制振鈴峰值嗎？ 

另，已經(jīng)重新打樣了單輸出的變壓器，后面再測(cè)試看看。

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feiban001
LV.3
18
2015-09-09 09:22
@謝厚林
噪音解決辦法，變壓器的磁芯中心柱點(diǎn)膠。
噪音的問(wèn)題，是否可以通過(guò)調(diào)整RCD改善？   我之前做的一個(gè)電源，LNK623，有一小部分噪音比較大。
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謝厚林
LV.12
19
2015-09-14 13:32
@feiban001
我再試試。 2.5us的位置，振鈴剛好結(jié)束。測(cè)了1/2/3nF的電容，RCD中D串聯(lián)的電阻也從0變到100，都試過(guò)，基本上都是在振鈴結(jié)束的地方剛好2.5uS之前將電容改小，似乎也沒(méi)有看到對(duì)振鈴有明顯改善的意思啊。 另外，直觀理解，電容大了不是有利于壓制振鈴峰值嗎？ 另，已經(jīng)重新打樣了單輸出的變壓器，后面再測(cè)試看看。

箝位電容大，振蕩的時(shí)間會(huì)久

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feiban001
LV.3
20
2015-09-14 17:27
@謝厚林
箝位電容大，振蕩的時(shí)間會(huì)久

最新的測(cè)試波形開了個(gè)新帖，煩請(qǐng)謝工幫忙看看。

http://www.e-ticket.cn/bbs/1516173.html

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2015-10-09 18:12
如果將4.5V輸出繞組去掉，只保留一組輸出，是否可以改善以上問(wèn)題？ 
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2015-10-09 19:04
@陌路絕途
你是多路輸出嗎？多路輸出的漏感大，造成Vds波形振蕩時(shí)間比較久。箝位電容改小點(diǎn)，改為470pF
噪音的問(wèn)題，是否可以通過(guò)調(diào)整RCD改善？   我之前做的一個(gè)電源，LNK623，有一小部分噪音比較大。
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2015-10-09 19:16
可聞噪音也變得明顯。30%~100%負(fù)載范圍內(nèi)都有噪音。
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dakjncdc
LV.7
24
2015-10-09 22:07
另外多路輸出會(huì)造成偵測(cè)不準(zhǔn)的問(wèn)題。
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2015-10-09 22:35
你是多路輸出嗎？多路輸出的漏感大，造成Vds波形振蕩時(shí)間比較久。箝位電容改小點(diǎn)，改為470pF
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2015-11-03 16:16
多路輸出的漏感大，造成Vds波形振蕩時(shí)間比較久。箝位電容改小點(diǎn)，改為470pF
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2015-11-03 17:33
你是多路輸出嗎？多路輸出的漏感大，造成Vds波形振蕩時(shí)間比較久。箝位電容改小點(diǎn)，改為470pF
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2015-11-03 17:53
輸出電壓逐漸下降到8.5V（純電阻負(fù)載）。
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2015-11-03 18:39
造成Vds波形振蕩時(shí)間比較久。箝位電容改小點(diǎn)，改為470pF
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