命苦...別人做FPGA邏輯,我在做配套電源,更苦的是過去沒有做過.特請高手指點:
1, 反激ACDC,漏磁會影響到漏極承受電壓.但是怎樣才能減小漏感呢?好像一般的線圈擾法效果不是特別明顯啊,比如Z擾法,三明治擾法等等.是不是除了讓廠家盡量均勻繞線,別無選擇?
2, 打樣回來的變壓器,如何測試其Lp和漏感?我想把次級開路,然后用萬用表測原邊電感,可行否?同樣,將次級短路,測試漏感可以嗎?
3, 看到很多人能直接測試漏極電壓,是怎么做到的?漏極電壓一般都能到600V,一般示波器肯定不行.除了特殊示波器,能否用電阻分壓來測試?如果電阻選擇太大,則阻容效應(yīng)可能會讓波形失真;如果太小,則會影響MOSFET正常工作.怎么協(xié)調(diào)?
4, 請大家推薦在深圳東莞比較好的變壓器廠家吧.想做EEL系列的變壓器,最好氣隙能研磨的.
誠摯請大家指點、交流.
反激電源變壓器的一些問題
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@szhjd
沒有老大肯幫忙嗎?
反激變換器主變壓器一般要磨 gap ﹐那么漏電感勢必會很大﹒
這時﹐您可以採取屏蔽的措施﹐具體繞線結(jié)構(gòu)可以參考三明治繞法﹐在未繞線前就貼一屏蔽或者用兩塊屏蔽把一﹐二次側(cè)分開﹐這樣應(yīng)該會在很大程度上降低Lk.
對于測試的話﹐那很簡單﹐用HP-4284A儀器進行測試﹐Lp也就是原邊的電感量﹐那您只要用測試夾夾住主繞組就可以了﹐對于Lk的測試﹐主繞組的夾具不要放開﹐在去短路您想要測試的某一繞組﹐測出來的值就是所短路那一組的Lk了哦﹒
對于第三個問題﹐我沒有那樣試過﹐不敢多說哦﹗
最后一點﹐現(xiàn)在的變壓器廠很難找﹐都市不上規(guī)模的還要挑產(chǎn)品做﹒
這時﹐您可以採取屏蔽的措施﹐具體繞線結(jié)構(gòu)可以參考三明治繞法﹐在未繞線前就貼一屏蔽或者用兩塊屏蔽把一﹐二次側(cè)分開﹐這樣應(yīng)該會在很大程度上降低Lk.
對于測試的話﹐那很簡單﹐用HP-4284A儀器進行測試﹐Lp也就是原邊的電感量﹐那您只要用測試夾夾住主繞組就可以了﹐對于Lk的測試﹐主繞組的夾具不要放開﹐在去短路您想要測試的某一繞組﹐測出來的值就是所短路那一組的Lk了哦﹒
對于第三個問題﹐我沒有那樣試過﹐不敢多說哦﹗
最后一點﹐現(xiàn)在的變壓器廠很難找﹐都市不上規(guī)模的還要挑產(chǎn)品做﹒
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@transformer1
反激變換器主變壓器一般要磨gap﹐那么漏電感勢必會很大﹒這時﹐您可以採取屏蔽的措施﹐具體繞線結(jié)構(gòu)可以參考三明治繞法﹐在未繞線前就貼一屏蔽或者用兩塊屏蔽把一﹐二次側(cè)分開﹐這樣應(yīng)該會在很大程度上降低Lk.對于測試的話﹐那很簡單﹐用HP-4284A儀器進行測試﹐Lp也就是原邊的電感量﹐那您只要用測試夾夾住主繞組就可以了﹐對于Lk的測試﹐主繞組的夾具不要放開﹐在去短路您想要測試的某一繞組﹐測出來的值就是所短路那一組的Lk了哦﹒ 對于第三個問題﹐我沒有那樣試過﹐不敢多說哦﹗最后一點﹐現(xiàn)在的變壓器廠很難找﹐都市不上規(guī)模的還要挑產(chǎn)品做﹒
你的關(guān)念有錯誤,事實上改變變壓器gap並不會改變變壓器漏感,或改變很大或簡量很明顯.
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@transformer1
樓上的兄弟講的是針對哪點﹒在電路中的哪個位置加吸收電路﹖ 盼復(fù)﹗
不好意思,來遲了點,我的意思不是說用吸收電路來降低漏感,而是針對由于漏感引起的反激電動勢過高而說的,是指在原邊加一個RC來降低反激電動勢對MOSFET的影響.
反激電動勢高也不完全是由于漏感的作用的,與變壓器匝數(shù)和變比都有關(guān)系.如果兄臺還沒有解決這個問題的話,可以發(fā)張圖上來,請這里的前輩們給你指點指點.
不過針對樓主所做的電源來說,我猜想功率應(yīng)該不是很大,輸出的電壓應(yīng)該也不高.不知道是用什么驅(qū)動的,是不是用TOPSwitch系列的呢?
就像 transformer1 兄弟說的一樣,反激是一定要留有氣隙的,啰嗦一下,簡單的方法是在兩片磁芯接觸的表面貼上一層膠帶,還有就如 transformer1 用磨的方式.
看著樓主的積分,可能來此也不久,估計也是一個像我一樣從事這個行業(yè)不久的晚輩,^_^
晚輩們就多發(fā)揚團結(jié)互助的精神吧,希望以后常交流!
反激電動勢高也不完全是由于漏感的作用的,與變壓器匝數(shù)和變比都有關(guān)系.如果兄臺還沒有解決這個問題的話,可以發(fā)張圖上來,請這里的前輩們給你指點指點.
不過針對樓主所做的電源來說,我猜想功率應(yīng)該不是很大,輸出的電壓應(yīng)該也不高.不知道是用什么驅(qū)動的,是不是用TOPSwitch系列的呢?
就像 transformer1 兄弟說的一樣,反激是一定要留有氣隙的,啰嗦一下,簡單的方法是在兩片磁芯接觸的表面貼上一層膠帶,還有就如 transformer1 用磨的方式.
看著樓主的積分,可能來此也不久,估計也是一個像我一樣從事這個行業(yè)不久的晚輩,^_^
晚輩們就多發(fā)揚團結(jié)互助的精神吧,希望以后常交流!
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@sanjin555
不好意思,來遲了點,我的意思不是說用吸收電路來降低漏感,而是針對由于漏感引起的反激電動勢過高而說的,是指在原邊加一個RC來降低反激電動勢對MOSFET的影響. 反激電動勢高也不完全是由于漏感的作用的,與變壓器匝數(shù)和變比都有關(guān)系.如果兄臺還沒有解決這個問題的話,可以發(fā)張圖上來,請這里的前輩們給你指點指點.不過針對樓主所做的電源來說,我猜想功率應(yīng)該不是很大,輸出的電壓應(yīng)該也不高.不知道是用什么驅(qū)動的,是不是用TOPSwitch系列的呢? 就像transformer1兄弟說的一樣,反激是一定要留有氣隙的,啰嗦一下,簡單的方法是在兩片磁芯接觸的表面貼上一層膠帶,還有就如transformer1用磨的方式. 看著樓主的積分,可能來此也不久,估計也是一個像我一樣從事這個行業(yè)不久的晚輩,^_^ 晚輩們就多發(fā)揚團結(jié)互助的精神吧,希望以后常交流!
太謙虛了哦﹐這論壇是個大家園﹐有問題大家一起討論﹗
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@transformer1
太謙虛了哦﹐這論壇是個大家園﹐有問題大家一起討論﹗
關(guān)于保護的問題,我是前段時間用TOP227做了一個200DC輸出100W的電源才深有體會的,以前做12V,19V輸出的時候,漏感不需要太考慮,用P6KE200做鉗位就可以了.
但后來做這個中壓直流電源,我嘗試了很久才把參數(shù)調(diào)節(jié)好,開始的時候由于變壓器匝數(shù)和繞法不良,前級的吸收管發(fā)燙厲害,空載時甚至燒了TOP227管,后面用兩個UF4005串聯(lián)整流都有擊穿的經(jīng)歷
現(xiàn)在把匝數(shù)都降到30左右,用EE28的磁芯,問題才得以解決.
不過目前PI的設(shè)計軟件上都不推薦使用采用反激式做輸出超過100V的設(shè)計.
但后來做這個中壓直流電源,我嘗試了很久才把參數(shù)調(diào)節(jié)好,開始的時候由于變壓器匝數(shù)和繞法不良,前級的吸收管發(fā)燙厲害,空載時甚至燒了TOP227管,后面用兩個UF4005串聯(lián)整流都有擊穿的經(jīng)歷
現(xiàn)在把匝數(shù)都降到30左右,用EE28的磁芯,問題才得以解決.
不過目前PI的設(shè)計軟件上都不推薦使用采用反激式做輸出超過100V的設(shè)計.
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@sanjin555
關(guān)于保護的問題,我是前段時間用TOP227做了一個200DC輸出100W的電源才深有體會的,以前做12V,19V輸出的時候,漏感不需要太考慮,用P6KE200做鉗位就可以了.但后來做這個中壓直流電源,我嘗試了很久才把參數(shù)調(diào)節(jié)好,開始的時候由于變壓器匝數(shù)和繞法不良,前級的吸收管發(fā)燙厲害,空載時甚至燒了TOP227管,后面用兩個UF4005串聯(lián)整流都有擊穿的經(jīng)歷現(xiàn)在把匝數(shù)都降到30左右,用EE28的磁芯,問題才得以解決.不過目前PI的設(shè)計軟件上都不推薦使用采用反激式做輸出超過100V的設(shè)計.
我想問一下﹐樓上的兄弟有沒有pi 設(shè)計軟件(不要網(wǎng)絡(luò)版的),因網(wǎng)絡(luò)版的我們公司用不了哦﹗
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