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DP83848C 使用損壞原因

本人設(shè)計的一款產(chǎn)品中,使用STM32F107VGT6與DP83848CVV組成LAN驅(qū)動電路(MII模式),功能都很正常,在工廠測試也未出現(xiàn)任何問題,在客戶手中使用半個月后,陸續(xù)出現(xiàn)產(chǎn)品不工作,不能連電腦。分析退回來的產(chǎn)品發(fā)現(xiàn)DP83848C的RESET腳對地短路,STM32F107也不能啟動。DP83848的RESET腳與STM32F107的RESET PIN 直連再通過100NF的電容接地。斷開DP83848C的RESETSTM32F107的RESET PIN之間的連接,STM32F107工作正常。通過萬用表粗略測試DP83848的GPIO阻抗,只有RESET PIN阻抗低至幾十歐姆,其它GPIO阻抗無異常。給正常DP83848供電,人為一直拉低RESET電平,其它GPIO電平與RESET PIN阻抗只有幾十歐姆的DP83848一樣。目前看起來DP83848只有RESET PIN損壞,但不知為何會損壞,而與其直連STM32F107 RESET PIN卻正常?如果將DP83848的RESET腳懸空是不是可以解決這個問題(假設(shè)是外部損壞,有沒有可能是從芯片內(nèi)部損壞?)?求幫助,謝謝!
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2019-02-08 08:10
沒圖,不好分析,為什么兩個芯片的復(fù)位接在一起?芯片某腳的損壞,可能是電源上竄入的干擾,或者電路設(shè)計的是否合理?這腳外圍原件參數(shù)是否合適?此外,損壞這芯片的IO口,是不是要在寄存器中配置IO的工作模式?還是認(rèn)真從芯片的說明書中找找原因,是不是哪里沒設(shè)置對?外圍電路沒設(shè)計好?
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2019-02-11 09:28
@lingyan
沒圖,不好分析,為什么兩個芯片的復(fù)位接在一起?芯片某腳的損壞,可能是電源上竄入的干擾,或者電路設(shè)計的是否合理?這腳外圍原件參數(shù)是否合適?此外,損壞這芯片的IO口,是不是要在寄存器中配置IO的工作模式?還是認(rèn)真從芯片的說明書中找找原因,是不是哪里沒設(shè)置對?外圍電路沒設(shè)計好?

/upload/community/2019/02/11/1549848395-64606.pdf

上圖是DP83848C的外圍電路原理圖,請幫忙看看是否有問題,謝謝!

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2019-02-11 13:27
@ashengzeng
/upload/community/2019/02/11/1549848395-64606.pdf上圖是DP83848C的外圍電路原理圖,請幫忙看看是否有問題,謝謝!
補(bǔ)充說明:因產(chǎn)品有瞬間沖放電動作,瞬間最高電壓可達(dá)370伏左右,有沒有可能是接地問題,但接地為何只損壞RESET腳?這有點難以解釋。
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