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共模電感能夠“隱含”多少差模電感？

看到很多電源的輸入端EMC處理，都是只有共模電感，沒有差模電感，聽有人說是繞制共模電感的到時(shí)候人為的調(diào)整兩個(gè)繞組，產(chǎn)生一個(gè)差模電感，從而對差模信號產(chǎn)生抑制作用，但是我心里比較狐疑，這么一點(diǎn)點(diǎn)差模電感，能起到的作用有多大？而且如果故意“不對稱”繞制共模電感的話，還會額外導(dǎo)致一些其它問題吧？會不會得不償失？謝謝！
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shao456
LV.6
2
2019-06-18 08:57
沒見過有故意讓共模電感的兩個(gè)電感不一致的，那樣會導(dǎo)致災(zāi)難性后果，所謂的等效差模電感就是共模電感的漏感，一般都很小
0
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2019-06-18 09:34

對差模電感來說，有10uH就起到效果了。

對于一個(gè)10mH的共模電感來說，即使有千分之一的誤差，就能滿足要求了。

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