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RCD箝不住位

    用EER28L做的5V12A變壓器,RCD電路好像沒什么作用

1:芯片TOP258YN,工作頻率66K.

2:箝位電路R:33K.  C:10NF.  D:FR207

3:變壓器初級(jí)電感540UH,漏感20UH,三明治繞法。

4:交流輸入電壓120V時(shí)的VDS波形如下,圖一是帶2A負(fù)載。圖二是帶3A負(fù)載。

5:圖三是變壓器結(jié)構(gòu)。變壓器中還有一組12V0.5A的輸出繞組,暫時(shí)沒有去調(diào)這部分。

   

 

全部回復(fù)(17)
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2010-12-06 11:52
我剛才測(cè)了輔助繞組的電壓,空載時(shí)14V,帶2A時(shí)到了到了35V,帶3A負(fù)載是到了45V嗎。郁悶中,不知變壓器出了什么問題
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謝厚林
LV.12
3
2010-12-06 12:29
@guangzhouyuhui
我剛才測(cè)了輔助繞組的電壓,空載時(shí)14V,帶2A時(shí)到了到了35V,帶3A負(fù)載是到了45V嗎。郁悶中,不知變壓器出了什么問題

輔助繞組盡量靠近次級(jí)才能把輔助繞組的電壓降下來。

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2010-12-06 12:30
@謝厚林
輔助繞組盡量靠近次級(jí)才能把輔助繞組的電壓降下來。

沒明白怎么個(gè)盡量靠近

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謝厚林
LV.12
5
2010-12-06 12:30
RCD的R可以改小點(diǎn),同時(shí)在電容C上串聯(lián)一個(gè)33R的電阻,消除Vds的振蕩。
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2010-12-06 12:30
@謝厚林
輔助繞組盡量靠近次級(jí)才能把輔助繞組的電壓降下來。

沒明白怎么個(gè)盡量靠近

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2010-12-06 12:32
@謝厚林
RCD的R可以改小點(diǎn),同時(shí)在電容C上串聯(lián)一個(gè)33R的電阻,消除Vds的振蕩。
現(xiàn)在關(guān)鍵是平臺(tái)以上的電壓那么高啊,問了代理吳工,他說是不是變壓器什么問題
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2010-12-06 13:03
@謝厚林
RCD的R可以改小點(diǎn),同時(shí)在電容C上串聯(lián)一個(gè)33R的電阻,消除Vds的振蕩。

串了一個(gè)33R也沒什么用

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謝厚林
LV.12
9
2010-12-06 14:54
@guangzhouyuhui
現(xiàn)在關(guān)鍵是平臺(tái)以上的電壓那么高啊,問了代理吳工,他說是不是變壓器什么問題

從Vor來看,你的電源的Vor 不大,比較大是漏感造成的尖刺。 

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2010-12-06 15:17
@謝厚林
從Vor來看,你的電源的Vor不大,比較大是漏感造成的尖刺。 

漏感是沒做到設(shè)計(jì)要求,設(shè)計(jì)時(shí)要10UH,到我實(shí)測(cè)的是25UH左右,但是也不至于平臺(tái)以上的電壓會(huì)有這么高啊

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謝厚林
LV.12
11
2010-12-07 03:52
@guangzhouyuhui
漏感是沒做到設(shè)計(jì)要求,設(shè)計(jì)時(shí)要10UH,到我實(shí)測(cè)的是25UH左右,但是也不至于平臺(tái)以上的電壓會(huì)有這么高啊

你可以做一個(gè)漏感低一點(diǎn)的來測(cè)試看。因?yàn)檫@里就是漏感影響的.

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2010-12-07 11:02
@謝厚林
你可以做一個(gè)漏感低一點(diǎn)的來測(cè)試看。因?yàn)檫@里就是漏感影響的.

謝工。我今天在測(cè)效率的時(shí)候發(fā)現(xiàn)個(gè)問題,我用電阻做的負(fù)載,當(dāng)電阻接上去電壓是4.96V,功率計(jì)的輸入功率是77W,當(dāng)我在輸出那里串一只萬用表測(cè)電流時(shí),電流時(shí)8.8A左右,用另一表測(cè)電壓也是4.96的樣子,但這時(shí)候功率計(jì)的輸入功率變小了,只有61W的樣子了。想不明白是什么原因

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2010-12-07 11:21
@guangzhouyuhui
謝工。我今天在測(cè)效率的時(shí)候發(fā)現(xiàn)個(gè)問題,我用電阻做的負(fù)載,當(dāng)電阻接上去電壓是4.96V,功率計(jì)的輸入功率是77W,當(dāng)我在輸出那里串一只萬用表測(cè)電流時(shí),電流時(shí)8.8A左右,用另一表測(cè)電壓也是4.96的樣子,但這時(shí)候功率計(jì)的輸入功率變小了,只有61W的樣子了。想不明白是什么原因

應(yīng)該是萬用表的內(nèi)阻造成的,我剛測(cè)了有0.5R

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謝厚林
LV.12
14
2010-12-07 14:11
@guangzhouyuhui
應(yīng)該是萬用表的內(nèi)阻造成的,我剛測(cè)了有0.5R

是的,萬用表有內(nèi)阻。

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2010-12-08 10:55
@謝厚林
是的,萬用表有內(nèi)阻。

謝工,我現(xiàn)在做的5V12A的電源VDS波形怎么是下面這樣子,我?guī)У?.4R的負(fù)載,輸入交流是150V,示波器每格式50V。上面那部分震蕩是哪里來的啊, 

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謝厚林
LV.12
16
2010-12-08 13:16
@guangzhouyuhui
謝工,我現(xiàn)在做的5V12A的電源VDS波形怎么是下面這樣子,我?guī)У?.4R的負(fù)載,輸入交流是150V,示波器每格式50V。上面那部分震蕩是哪里來的啊,[圖片] 

上面的振蕩是漏感造成的。

1。減少漏感。2, 加大漏感吸收能力。

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coper920
LV.2
17
2010-12-09 13:21
@謝厚林
輔助繞組盡量靠近次級(jí)才能把輔助繞組的電壓降下來。
謝工,能否將輔助繞組反向繞制,不和次級(jí)同步呢?也就是說我只要保證輔助繞組的電壓在最低AC輸入時(shí)滿足大于8V,最高AC輸入時(shí)不超過光耦耐壓。
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謝厚林
LV.12
18
2010-12-09 14:12
@coper920
謝工,能否將輔助繞組反向繞制,不和次級(jí)同步呢?也就是說我只要保證輔助繞組的電壓在最低AC輸入時(shí)滿足大于8V,最高AC輸入時(shí)不超過光耦耐壓。

可以,不過問題高壓是輔助繞組的電壓高了之后,損耗很大。

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