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工作時(shí)電壓下降幅度太大···

如圖，我做的一個(gè)電源，13.5V是載波通信用的，當(dāng)通信時(shí)13.5V下降到了8V左右，降的幅度太多了，如何做變壓器才能讓 電壓下降的幅度小點(diǎn)呢，比如說降到12V這樣子。輸出是加了假負(fù)載的。

 

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2012-01-14 16:45
或者說在外圍電路做什么改進(jìn)？求教！
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2012-01-14 19:03
@huangzhaoqiu
或者說在外圍電路做什么改進(jìn)？求教！
13.5V那一組都沒有調(diào)電壓輸出肯定降啦
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2012-01-15 00:43
@huobao5257
13.5V那一組都沒有調(diào)電壓輸出肯定降啦
知道肯定會(huì)降，但是如何做能讓它降得少點(diǎn)呢
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2012-01-15 01:13
@huangzhaoqiu
知道肯定會(huì)降，但是如何做能讓它降得少點(diǎn)呢
可參照pc電源處理辦法，增加從13.5v電壓按比例取樣，輸出電感做成共扼式（繞在同一個(gè)一個(gè)磁環(huán)上）。最徹底的辦法是只穩(wěn)定13.5v，5v用dc-dc降壓。
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leelsuc
LV.2
6
2012-01-15 02:16
@huangzhaoqiu
或者說在外圍電路做什么改進(jìn)？求教！
我覺得計(jì)算不對(duì)。我是紙上談兵，按照書上的多路輸出的反饋設(shè)計(jì)，各路的輸出空載重載都是算好的。
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edward372
LV.4
7
2012-01-15 07:41
@leelsuc
我覺得計(jì)算不對(duì)。我是紙上談兵，按照書上的多路輸出的反饋設(shè)計(jì)，各路的輸出空載重載都是算好的。
**此帖已被管理員刪除**
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2012-01-15 09:00
@ymyangyong
可參照pc電源處理辦法，增加從13.5v電壓按比例取樣，輸出電感做成共扼式（繞在同一個(gè)一個(gè)磁環(huán)上）。最徹底的辦法是只穩(wěn)定13.5v，5v用dc-dc降壓。
謝謝，我不想用DC-DC，試試你說第一種辦法看效果怎么樣
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2012-01-15 09:02
大師們多多指點(diǎn)一下啊
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2012-01-15 10:05
@ymyangyong
可參照pc電源處理辦法，增加從13.5v電壓按比例取樣，輸出電感做成共扼式（繞在同一個(gè)一個(gè)磁環(huán)上）。最徹底的辦法是只穩(wěn)定13.5v，5v用dc-dc降壓。

謝謝，學(xué)習(xí)了。剛自己繞了個(gè)共軛線圈，13.5V不采樣只加共軛線圈，效果的確好了很多，只降了1.2V基本可以接受，繼續(xù)看能否有更好的改進(jìn)。

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2012-01-15 10:14
@ymyangyong
可參照pc電源處理辦法，增加從13.5v電壓按比例取樣，輸出電感做成共扼式（繞在同一個(gè)一個(gè)磁環(huán)上）。最徹底的辦法是只穩(wěn)定13.5v，5v用dc-dc降壓。
原理是怎么樣的呢？我的理解是磁勢(shì)疊加了，然后13.5V回路能使用5V回路的部分能量，從而使13.5V回路的電壓達(dá)到穩(wěn)定的效果。不知理解是否正確，請(qǐng)指教。
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jianyedin
LV.9
12
2012-01-15 10:14
@huangzhaoqiu
大師們多多指點(diǎn)一下啊[圖片]
L1,L2前應(yīng)有電容
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2012-01-15 10:40
@jianyedin
L1,L2前應(yīng)有電容
想節(jié)約成本。
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jianyedin
LV.9
14
2012-01-15 15:56
@huangzhaoqiu
想節(jié)約成本。
這可不能省啊
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2012-01-15 23:40
@jianyedin
這可不能省啊
增加從13.5v電壓按比例采樣，如5v上端采樣電阻為5k，則13.5v采樣電阻為13.5k，完了再調(diào)小下端采樣電阻使5v電壓正常，該辦法為綜合采樣，如對(duì)5v電壓精準(zhǔn)度要求較高的話不推薦使用。
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2012-01-15 23:42
@ymyangyong
增加從13.5v電壓按比例采樣，如5v上端采樣電阻為5k，則13.5v采樣電阻為13.5k，完了再調(diào)小下端采樣電阻使5v電壓正常，該辦法為綜合采樣，如對(duì)5v電壓精準(zhǔn)度要求較高的話不推薦使用。
另共軛線圈圈數(shù)建議按輸出電壓比例做，根據(jù)實(shí)際效果調(diào)整。
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2012-01-20 13:40
@ymyangyong
另共軛線圈圈數(shù)建議按輸出電壓比例做，根據(jù)實(shí)際效果調(diào)整。
共軛是和地共軛還是和5V輸出共軛呢？我試了下和地效果也差不多。
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2012-01-21 10:07
@huangzhaoqiu
共軛是和地共軛還是和5V輸出共軛呢？我試了下和地效果也差不多。
和5V輸出共軛
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leelsuc
LV.2
19
2012-01-24 00:56
@edward372
**此帖已被管理員刪除**

紙上談兵： 書上是這么說的： Weighted feedback offers superior performance
in multioutput configurations.

然后你設(shè)計(jì)時(shí)候缺少了一路反饋（嚴(yán)重錯(cuò)誤），c4處是零點(diǎn)，增加R3有什么講究？書上這里沒有R3（可能錯(cuò)誤）

以上全是照本宣科。

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leelsuc
LV.2
20
2012-01-24 00:59
@huangzhaoqiu
想節(jié)約成本。

書上沒見過你的省法，但是假設(shè)你沒有忘記輸出級(jí)電容，你這里二級(jí)LC濾波引入的環(huán)路補(bǔ)償還要復(fù)雜一點(diǎn)。

這些都是照本宣科的知識(shí)。

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bigbigeasy
LV.6
21
2012-01-24 23:34
@huangzhaoqiu
或者說在外圍電路做什么改進(jìn)？求教！

你可以把13.5的繞組和主繞組耦合變差

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hh123
LV.4
22
2012-01-24 23:45

13.5V一路電流小的話建議使用DC stack，將繞組接到D2的后面

電流大的話建議加電阻到TL431

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