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功率地回路對輸出電壓的影響

FB 是誤差放大器的負輸入端,這是個高阻抗腳位,因此容易耦合一些噪聲,在實際應(yīng)用中,常常會遇見分壓電阻 R1 和 R2 放在輸出電容端,導(dǎo)致 FB 走線較長,這條走線充當了天線,更加容易耦合非真實反饋,繼而引起輸出電壓變化或者不穩(wěn)。

在電路布線中, FB 走線盡可能短,分壓電阻 R1 和 R2 應(yīng)靠近 IC 的 FB 管腳布置,而 Vout 是直流電平,抗干擾能力強,可以做長走線。

當輸出電流比較小時,R2 的地可以選擇在芯片的地附近連接。但是如果輸出電流>10A,且地走線敷銅有限時,地線上會損失電壓,導(dǎo)致實際的輸出電壓會比預(yù)設(shè)電壓小,這種情況,需要做遠端采樣。

實際上我并不認可上面這種遠端方式可以彌補GND壓降的影響,下面是分析過程。

其實比較大的爭議在于EA的參考地在哪里,前面圖片中都是近端的電源芯片地,那么功率地壓降就會在輸出電壓回路里。

如果芯片反饋是差分信號,有自己的差分信號地,那么遠端反饋彌補功率地壓降才能實現(xiàn)。

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魯珀特
LV.4
2
2022-10-26 09:56

總的來看,還是受到反饋電阻影響較大。接地不好,阻抗較大。

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aebote
LV.1
3
2022-10-26 11:21

弱弱的問下,layout有沒有類似雙絞之類的抗干擾走線?

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天晴朗
LV.6
4
2022-10-26 17:29

需要考慮功率地影響,實際芯片得到的電壓會減小

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2022-10-26 17:49
@aebote
弱弱的問下,layout有沒有類似雙絞之類的抗干擾走線?

有一些IC會有2個pin做反饋,是你說的這種差分反饋

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2022-10-26 17:50
@魯珀特
總的來看,還是受到反饋電阻影響較大。接地不好,阻抗較大。

功率地的壓降不可避免

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2022-10-26 17:50
@天晴朗
需要考慮功率地影響,實際芯片得到的電壓會減小

可以做壓降補償來消除,需要反饋得到真實的負載端電壓

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2022-10-26 19:31

電阻對最終電路輸出有干擾么

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2022-10-26 23:39

如何有效減小回路過程中產(chǎn)生的噪聲

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2022-10-27 09:27
@dy-n66BzSV7
電阻對最終電路輸出有干擾么

不是干擾,是會影響實際負載芯片得到的電壓小于設(shè)定值

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2022-10-27 13:55

當輸出電流比較小時,R2 的地可以選擇在芯片的地附近連接。但是如果輸出電流>10A,且地走線敷銅有限時,地線上會損失電壓,導(dǎo)致實際的輸出電壓會比預(yù)設(shè)電壓小,這種情況,需要做遠端采樣。

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Marcia
LV.6
12
2022-10-27 14:39

比較大的爭議在于EA的參考地在哪里?

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聽聽1234
LV.5
13
2022-10-28 08:47

在電路布線中, FB 走線盡可能短,分壓電阻 R1 和 R2 應(yīng)靠近 IC 的 FB 管腳布置,而 Vout 是直流電平,抗干擾能力強,可以做長走線。

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dy-TMelSvc9
LV.8
14
2022-10-28 23:18

差分信號如何做能量補償

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liweicheng
LV.7
15
2022-10-29 13:03

這個多講一講,受益還是挺好的,F(xiàn)B采樣電阻精密度還是有要求的

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liweicheng
LV.7
16
2022-10-29 13:05

這樣的運放還是加個外置偏置電壓,或是有個COMP補償,對微弱的采樣信號也有幫助

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2022-10-30 00:15

一般是把誤差放大器的地放在供電回路上,這樣受功率回路干擾較小

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2022-11-08 15:49

這種設(shè)計是不是一般電源會采用近端和遠端進行采樣控制反饋了?保證輸出精度及穩(wěn)定性。

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2022-11-08 15:50
@快樂的小天使
功率地的壓降不可避免

是的,功率地壓降都比較大,需要合理設(shè)計及PCB布局。

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海怒
LV.2
20
2022-11-26 00:02

遠端取信號應(yīng)該不存在問題吧,參考地和參考電平與遠端信號地是同電平,前提是你pcb得設(shè)計好

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dy-nmLUWFNr
LV.8
21
2022-11-26 09:27

反加電壓會對電路工作產(chǎn)生影響么

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dy-StTIVH1p
LV.8
22
2022-11-26 11:03

有沒有線性曲線可以完整表述變化

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dy-TMelSvc9
LV.8
23
2022-11-26 11:13

施加反向電壓會有幫助么

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dy-7yarl3tv
LV.3
24
2022-11-26 11:16

要么采用遠端差分信號反饋,要么采用開爾文反饋方式,兩者基本是同一個意思

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dy-7yarl3tv
LV.3
25
2022-11-26 11:18
@魯珀特
總的來看,還是受到反饋電阻影響較大。接地不好,阻抗較大。

線壓降和采樣電壓壓降影響都比較大,所以要加入檢測端+S和-S

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2022-11-26 16:41

PCB布局對采樣結(jié)果影響比較大啊

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fda
LV.2
27
2022-11-26 22:41

這個比較實用,經(jīng)常在實際運行中出現(xiàn)

 

 

 

 

 

 

 

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dy-nmLUWFNr
LV.8
28
2022-11-26 22:53

差分信號對最終輸出效率會有影響么

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dy-n66BzSV7
LV.6
29
2022-11-26 23:21

有沒有具體的電路圖可以分享討論一下

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dy-n66BzSV7
LV.6
30
2022-11-27 13:09

功率輸出曲線會呈現(xiàn)怎么樣的變化

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dy-mb2U9pBf
LV.8
31
2022-11-28 12:41

這個可能要考慮layout的時候怎么布局吧,能加上這個就更清晰了

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