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Inno反激電源次級(jí)整流設(shè)計(jì)

反激電源如果不追求效率,特別是小功率電源,需要優(yōu)化成本時(shí)一般都選擇次級(jí)二極管整流,簡(jiǎn)單可靠。但對(duì)于大電流的反激電源,雖然使用簡(jiǎn)單的二極管整流器和濾波器足以滿足輸出的需要,但二極管整流的劣勢(shì)會(huì)體現(xiàn)出來(lái),如果使用SR FET能顯著提高工作效率,進(jìn)而滿足歐洲CoC和美國(guó)能源部(DoE)能效標(biāo)準(zhǔn)要求。

FET設(shè)計(jì)與選型注意事項(xiàng):

SR FET柵極應(yīng)直接連接至這款控制器的同步整流管驅(qū)動(dòng)引腳,不在SR FET柵極電路連接任何額外的電阻。SR FET驅(qū)動(dòng)器使用次級(jí)旁路引腳作為供電端,該電壓的典型值為4.4 V。因此不太適合使用高開(kāi)通閾值電壓的MOSFET;開(kāi)通閾值電壓在1.5 V2.5 V之間的MOSFET較為適合RDS(ON)一般是 8 mOhm~18mOhm用的比較多。

反激周期開(kāi)始與SR FET導(dǎo)通之間稍微有一點(diǎn)延遲。在此期間, SR FET的體二極管傳導(dǎo)電流。如果使用外部并聯(lián)肖特基二極管,該電流大部分都流經(jīng)肖特基二極管。主要是體二極管壓降一般比肖特基二極管大一些。

InnoSwitch3-CP IC檢測(cè)到反激周期結(jié)束時(shí), SR FETRDS(ON)兩端電壓達(dá)到0 V,反激周期的剩余部分期間電流將換向至SR FET的體二極管或外部并聯(lián)肖特基二極管。使用與SR FET并聯(lián)的肖特基二極管可以提供更高效率,通常一個(gè)1 A表面貼裝肖特基二極管已足夠滿足使用需要。

 輸出繞組的漏感與SR FET電容(COSS)之間的相互作用會(huì)在繞組的電壓反向(由于初級(jí)開(kāi)關(guān)導(dǎo)通)時(shí)電壓波形出現(xiàn)振蕩。這種振蕩可通過(guò)使用連接于SR FET兩端的RC緩沖器進(jìn)行抑制。緩沖器電阻阻值范圍介于10 W47 W之間(較高的電阻值會(huì)導(dǎo)致比較明顯的效率下降)。大部分設(shè)計(jì)當(dāng)中均可采用1 nF2.2 nF的電容值。

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2024-05-23 10:12

怎么樣有效降低多級(jí)傳輸電路產(chǎn)生的能量損耗

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htwdb
LV.7
3
2024-05-23 15:19

FET的損耗通常非常低,PCB跡線銅箔和平面可作為散熱設(shè)計(jì),將結(jié)溫保持在合理的范圍內(nèi)

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2024-05-23 17:51

怎么樣有效檢測(cè)反激電源的信號(hào)傳輸

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2024-05-23 18:27

整流電路對(duì)信號(hào)傳輸有哪些影響

0
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only one
LV.8
6
2024-05-23 23:55

反激周期開(kāi)始與SR FET導(dǎo)通之間稍微有一點(diǎn)延遲,這個(gè)延遲是好處還是壞處?

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2024-05-24 09:20

怎么樣確保次級(jí)整流的傳輸一直穩(wěn)定

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沈夜
LV.8
8
2024-05-25 17:41

如何選擇適合的二極管整流器或SR FET?

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千影
LV.6
9
2024-05-25 17:57

SR FET應(yīng)用在反激電源中能顯著提高效率,設(shè)計(jì)時(shí)需注意選型與細(xì)節(jié)優(yōu)化。

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2024-05-26 20:52

非常棒的設(shè)計(jì)

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XHH9062
LV.9
11
2024-05-26 22:15

次級(jí)整流的溫升問(wèn)題一般怎么解決

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CDJ01
LV.5
12
2024-05-26 23:11

將原邊MOS和負(fù)邊整流管封裝在一起,和傳統(tǒng)分立器件相比效率能提高多少

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k6666
LV.9
13
2024-06-06 14:16
@dy-XU5vrphW
整流電路對(duì)信號(hào)傳輸有哪些影響

反激式控制器可在整個(gè)負(fù)載范圍內(nèi)提供恒定的效率,并且空載功耗低于5mW

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xxbw6868
LV.10
14
2024-06-07 11:50
@dy-StTIVH1p
怎么樣有效降低多級(jí)傳輸電路產(chǎn)生的能量損耗

為了降低待機(jī)功耗,大部分電源芯片都采取輕載降頻的控制方式。

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spowergg
LV.10
15
2024-06-08 11:48
@xxbw6868
為了降低待機(jī)功耗,大部分電源芯片都采取輕載降頻的控制方式。

由于待機(jī)時(shí)有效工作頻率很低,并且一般限流點(diǎn)很小,磁通變化小,磁芯損耗很小,對(duì)待機(jī)影響不大,但繞組損耗是不可忽略的。

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yangweiping
LV.5
16
2024-06-28 17:08

同步整流,提高效率,減小發(fā)熱。

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2024-07-09 09:36

芯片的二次側(cè)由二次繞組正向電壓或輸出電壓自供電。輸出電壓為器件供電,輸入到VO引腳。它將通過(guò)一個(gè)內(nèi)部調(diào)節(jié)器對(duì)去耦電容器充電

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k6666
LV.9
18
2024-07-09 14:35
@dy-TMelSvc9
怎么樣有效檢測(cè)反激電源的信號(hào)傳輸

進(jìn)入FB引腳的電流大于49µA將抑制內(nèi)部MOSFET的開(kāi)關(guān),而低于49µA的電流允許發(fā)生開(kāi)關(guān)周期。

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方笑塵MK
LV.8
19
2024-07-13 09:30

次級(jí)整流可以采用傳統(tǒng)的二極管或同步整流MOSFET。同步整流可以減少整流損耗,提高效率

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2024-09-06 14:30
@xxbw6868
為了降低待機(jī)功耗,大部分電源芯片都采取輕載降頻的控制方式。

采用獨(dú)有的變頻開(kāi)關(guān)控制方式,可根據(jù)數(shù)字信號(hào)的反饋調(diào)節(jié)輸出。

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方笑塵MK
LV.8
21
2024-09-09 18:17

由于二極管在整流過(guò)程中會(huì)有功率損耗,因此需要考慮散熱問(wèn)題,特別是在高電流應(yīng)用中

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