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求助:dsp擴展IO口 cpld的問題

如圖:
LDAC DAC等輸出信號都能產(chǎn)生下降沿脈沖
而 左下腳和右下角的lcd_cs1和lcd_cs2信號始終是高電平
不知道是不是cpld這兩個腳壞了 改了maxplus程序中引腳邏輯順序 問題依舊
ps:這是第二塊板子 硬件電路應該沒問題

thanks!!
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