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低壓大電流如何提高效率？

請大家?guī)臀页龀龈哒?，能否在低壓?.9V）電流20A時，效率達(dá)到90%以上
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hk2007
LV.8
2
2010-11-17 11:06

比較有難度。等著高人來指點(diǎn)吧……

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pslong
LV.3
3
2010-11-17 11:08

附加說明不需要隔離。

0
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pslong
LV.3
4
2010-11-17 11:14
輸入范圍3.5V-5.5V
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恒流王
LV.5
5
2010-11-17 11:52
@pslong
輸入范圍3.5V-5.5V
就使用buck,+同步整流,差不多90%+
0
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2010-11-17 13:15
@恒流王
就使用buck,+同步整流,差不多90%+

0.9V 20A能做到90%？？？

不說別的損耗，就算是電感+PCB走線+同步整流MOS的壓降，0.1V的壓降，你覺得有多大的機(jī)會？

所以，這簡直在天方夜談

0
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2010-11-17 13:18
好像，BUCK&同步整流會高一些。
0
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2010-11-17 13:19
我覺得是不是要加上軟開關(guān)。這么低的沒玩過，電流太大了。
0
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恒流王
LV.5
9
2010-11-17 13:43
@心中有冰
0.9V20A能做到90%？？？[圖片]不說別的損耗，就算是電感+PCB走線+同步整流MOS的壓降，0.1V的壓降，你覺得有多大的機(jī)會？所以，這簡直在天方夜談

老夫若是做出來,如何?

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songxium
LV.7
10
2010-11-17 13:58
0.9V感覺很難穩(wěn)定。
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2010-11-17 15:20
@恒流王
老夫若是做出來,如何?

先消消氣，這里不是斗狠的地方，討論技術(shù)為宗旨！

你認(rèn)為可以，說說你的理由，找出反駁我的觀點(diǎn)的地方！

0
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fly
12
2010-11-17 15:55

關(guān)注一下，很有挑戰(zhàn)啊

0
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恒流王
LV.5
13
2010-11-17 16:02
@心中有冰
先消消氣，這里不是斗狠的地方，討論技術(shù)為宗旨！你認(rèn)為可以，說說你的理由，找出反駁我的觀點(diǎn)的地方！
并聯(lián)
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恒流王
LV.5
14
2010-11-17 16:02
@心中有冰
先消消氣，這里不是斗狠的地方，討論技術(shù)為宗旨！你認(rèn)為可以，說說你的理由，找出反駁我的觀點(diǎn)的地方！
并聯(lián)
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XXKGDY
LV.6
15
2010-11-17 16:03
@fly
關(guān)注一下，很有挑戰(zhàn)啊

等待學(xué)習(xí)。

0
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ppfc_ctr
LV.6
16
2010-11-17 18:13
電流很大哇，器件上的、PCB上的損耗都不好控制
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sl_power
LV.7
17
2010-11-17 19:17
確實(shí)很具挑戰(zhàn)性，期待電源網(wǎng)的牛人能夠出來指點(diǎn)，關(guān)注中……
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2010-11-17 19:55
@恒流王
并聯(lián)

呵呵，我也覺得挺有難度的。。不過實(shí)踐出真理。。

0
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hourdown
LV.6
19
2010-11-17 20:10
@sl_power
確實(shí)很具挑戰(zhàn)性，期待電源網(wǎng)的牛人能夠出來指點(diǎn)，關(guān)注中……
MARK
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flyahead
LV.5
20
2010-11-17 20:24
@hourdown
MARK
關(guān)注
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lvyuanpu
LV.5
21
2010-11-17 20:40
@恒流王
老夫若是做出來,如何?
關(guān)注啊
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pslong
LV.3
22
2010-11-18 09:56
@恒流王
并聯(lián)

謝謝大家的關(guān)注，在此感謝！現(xiàn)在的FPGA內(nèi)核電壓越來越低了，由1.8V-1.5V-1.2V-1V-0.9V變化趨勢，據(jù)說0.8V的即將來臨；困難啊!剛才老兄說并聯(lián)輸出可以試試，但均流和體積也得考慮。期待指點(diǎn)。

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pslong
LV.3
23
2010-11-18 10:00
@powercheng
好像，BUCK&同步整流會高一些。
同步整流肯定的，電感+PCB走線+同步整流MOS的壓降，0.1V的壓降，你覺得能實(shí)現(xiàn)嗎？本人很困惑！
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pslong
LV.3
24
2010-11-18 10:02
@songxium
0.9V感覺很難穩(wěn)定。
穩(wěn)定應(yīng)該可以，現(xiàn)在芯片的反饋基準(zhǔn)電壓到0.8V以下了
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2010-11-18 10:14
@恒流王
并聯(lián)
即使并聯(lián)，這個0.1V的直流損耗都夠嗆，更何況電路還存在這高頻交流損耗，開關(guān)損耗等等
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pslong
LV.3
26
2010-11-18 10:52
@心中有冰
即使并聯(lián)，這個0.1V的直流損耗都夠嗆，更何況電路還存在這高頻交流損耗，開關(guān)損耗等等
0.1V的直流損耗可不可以通過用2毫歐以下的mos管來降低損耗（同步整流）
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2010-11-18 11:08
@pslong
0.1V的直流損耗可不可以通過用2毫歐以下的mos管來降低損耗（同步整流）
開關(guān)損耗？
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pslong
LV.3
28
2010-11-18 11:24
@心中有冰
開關(guān)損耗？

導(dǎo)通壓降損耗

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恒流王
LV.5
29
2010-11-18 12:14
@pslong
謝謝大家的關(guān)注，在此感謝！現(xiàn)在的FPGA內(nèi)核電壓越來越低了，由1.8V-1.5V-1.2V-1V-0.9V變化趨勢，據(jù)說0.8V的即將來臨；困難啊!剛才老兄說并聯(lián)輸出可以試試，但均流和體積也得考慮。期待指點(diǎn)。
不知道這種模塊電源出貨量是多少?成本控制在多大范圍?長寬高控制在多大以內(nèi)?1.8V-1.5V-1.2V-1V-0.9V/20A應(yīng)該都可以實(shí)現(xiàn)較高效率的吧,可能的話想實(shí)踐一下.
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恒流王
LV.5
30
2010-11-18 12:33
@flyahead
關(guān)注
不知道這種模塊電源出貨量是多少?成本控制在多大范圍?長寬高控制在多大以內(nèi)?1.8V-1.5V-1.2V-1V-0.9V/20A應(yīng)該都可以實(shí)現(xiàn)較高效率的吧,可能的話想實(shí)踐一下.
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恒流王
LV.5
31
2010-11-18 13:47
@pslong
同步整流肯定的，電感+PCB走線+同步整流MOS的壓降，0.1V的壓降，你覺得能實(shí)現(xiàn)嗎？本人很困惑！
電感電流不過5A多一點(diǎn),PCB只要走線短壓降基本忽略,至于同步mos壓降可采用幾個毫歐的mos,所以肯定能實(shí)現(xiàn)
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