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你那個(gè)3.3V，10A好像確實(shí)要加同步整流了，我想問(wèn)下，這么高的電流，初級(jí)的FETcurrentsense電阻這么選擇??？功耗很大??？

你好，真的很謝謝你的建議，我現(xiàn)在剛接觸這類(lèi)電源頭都大了，我還是先用反激試驗(yàn)下吧，可是同皮要怎么設(shè)計(jì)呢？厚度和寬度，我沒(méi)有概念關(guān)于這個(gè)。

我需要做一個(gè)輸入是18V～36V,輸出是12V/5A，要求隔離的DC-DC電源，所以我認(rèn)為反激還是比較合適的，只是設(shè)計(jì)時(shí)我在最低輸入電壓18V條件下設(shè)計(jì)，輸入輸出太相近了，匝數(shù)比很低，而且DC-DCflyback電源的開(kāi)關(guān)頻率很高，這樣我的肌膚效應(yīng)很明顯，所以我大概算下，如果在100KHZ條件下，線(xiàn)徑不能超過(guò)0.42mm，所以算下來(lái)初級(jí)10跟線(xiàn)并聯(lián)，次級(jí)要8根線(xiàn)并聯(lián)。這樣做可以嗎？我的core是不是用EER35的？

我再更正下，負(fù)載還是12V/5A，所以反激還是比較合適的，只是設(shè)計(jì)時(shí)我在最低輸入電壓18V條件下設(shè)計(jì)，輸入輸出太想近了，匝數(shù)比很低，而且DC-DCflyback電源的開(kāi)關(guān)頻率很高，這樣我的肌膚效應(yīng)很明顯，所以我大概算下，如果在100KHZ條件下，線(xiàn)徑不能超過(guò)0.42mm，所以算下來(lái)初級(jí)10跟線(xiàn)并聯(lián)，次級(jí)要8根線(xiàn)并聯(lián)。這樣做可以嗎？我的core是不是用EER35的？

我再更正下，負(fù)載還是12V/5A，所以反激還是比較合適的，只是設(shè)計(jì)時(shí)我在最低輸入電壓18V條件下設(shè)計(jì)，輸入輸出太想近了，匝數(shù)比很低，而且DC-DCflyback電源的開(kāi)關(guān)頻率很高，這樣我的肌膚效應(yīng)很明顯，所以我大概算下，如果在100KHZ條件下，線(xiàn)徑不能超過(guò)0.42mm，所以算下來(lái)初級(jí)10跟線(xiàn)并聯(lián)，次級(jí)要8根線(xiàn)并聯(lián)。這樣做可以嗎？我的core是不是用EER35的？  

我重新確認(rèn)了負(fù)載端，需要達(dá)到9A的量，我按照你的方法設(shè)計(jì)做demo板吧，有問(wèn)題再咨詢(xún)下您，謝謝你耐心的講解。

我算了下還是要用同步整理的，電流太大了，電壓又低，次級(jí)損耗可能都要好5－6W了

謝謝CHENG111,我現(xiàn)在還是想先用下反激，主要是這個(gè)熟悉，另外cost方面，如果同步整理會(huì)高出很多的吧？

我認(rèn)為可以用Fly-back先降下電壓到24V，然后用buck－boost。